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Microprocessadores AM3352BZCZA100 – MPU ARM Cortex-A8 MPU

Microprocessadores AM3352BZCZA100 – Imagem em destaque do MPU ARM Cortex-A8 MPU
  • Microprocessadores AM3352BZCZA100 – MPU ARM Cortex-A8 MPU
  • Microprocessadores AM3352BZCZA100 – MPU ARM Cortex-A8 MPU

Descrição curta:

Fabricantes: Texas Instruments
Categoria do produto: Microprocessadores – MPU
Ficha de dados:AM3352BZCZA100
Descrição: IC MPU SITARA 1.0GHZ 324NFBGA
Status RoHS: compatível com RoHS


Envie um e-mail para nós

Detalhes do produto

Características

Aplicações

Etiquetas de produtos

♠ Descrição do produto

Atributo do produto Valor do Atributo
Fabricante: Instrumentos Texas
Categoria do produto: Microprocessadores - MPU
RoHS: Detalhes
Estilo de montagem: SMD/SMT
Pacote/Caixa: PBGA-324
Série: AM3352
Essencial: ARM Cortex A8
Número de núcleos: 1 núcleo
Largura do barramento de dados: 32 bits
Frequência máxima do relógio: 1 GHz
Memória de instruções de cache L1: 32 kB
Memória de dados de cache L1: 32 kB
Tensão de alimentação operacional: 1,325 V
Temperatura mínima de operação: - 40°C
Temperatura máxima de operação: + 125 °C
Embalagem: Bandeja
Marca: Instrumentos Texas
Tamanho da RAM de dados: 64 kB, 64 kB
Tamanho da ROM de dados: 176 kB
Kit de desenvolvimento: TMDXEVM3358
Tensão de E/S: 1,8 V, 3,3 V
Tipo de interface: CAN, Ethernet, I2C, SPI, UART, USB
Instrução de cache L2 / Memória de dados: 256 kB
Tipo de memória: Cache L1/L2/L3, RAM, ROM
Sensível à umidade: Sim
Número de temporizadores/contadores: 8 Temporizador
Série do processador: Sitara
Tipo de produto: Microprocessadores - MPU
Quantidade de embalagem de fábrica: 126
Subcategoria: Microprocessadores - MPU
Nome comercial: Sitara
Temporizadores de Watchdog: Temporizador de cão de guarda
Peso unitário: 1,714 g

♠ Processadores AM335x Sitara™

Os microprocessadores AM335x, baseados no processador ARM Cortex-A8, são aprimorados com opções de imagem, processamento gráfico, periféricos e interface industrial, como EtherCAT e PROFIBUS. Os dispositivos suportam sistemas operacionais de alto nível (HLOS). O SDK do processador Linux® e o TI-RTOS estão disponíveis gratuitamente na TI.

O microprocessador AM335x contém os subsistemas mostrados no Diagrama de Blocos Funcionais e segue uma breve descrição de cada um:

O contém os subsistemas mostrados no Diagrama de Blocos Funcionais e uma breve descrição de cada um segue:

O subsistema da unidade de microprocessador (MPU) é baseado no processador ARM Cortex-A8 e o subsistema PowerVR SGX™ Graphics Accelerator fornece aceleração gráfica 3D para suportar efeitos de exibição e jogos. O PRU-ICSS é separado do núcleo ARM, permitindo operação e clock independentes para maior eficiência e flexibilidade.

O PRU-ICSS habilita interfaces periféricas adicionais e protocolos de tempo real, como EtherCAT, PROFINET, EtherNet/IP, PROFIBUS, Ethernet Powerlink, Sercos e outros. Além disso, a natureza programável do PRU-ICSS, juntamente com seu acesso a pinos, eventos e todos os recursos do sistema em um chip (SoC), oferece flexibilidade na implementação de respostas rápidas em tempo real, operações especializadas de tratamento de dados, interfaces periféricas personalizadas e na transferência de tarefas dos outros núcleos do processador do SoC.


  • Anterior: TJA1040T/CM,118 CAN Interface IC Transceptor CAN de alta velocidade com modo de espera
  • Próximo: Microcontroladores ARM AT91R40008-66AU – MCU LQFP IND TEMP

  • • Processador Sitara™ ARM® Cortex® -A8 RISC de 32 bits de até 1 GHz

    – Coprocessador NEON™ SIMD

    – 32 KB de instrução L1 e 32 KB de cache de dados com detecção de erro único (paridade)

    – 256 KB de cache L2 com código de correção de erros (ECC)

    – 176 KB de ROM de inicialização no chip

    – 64 KB de RAM dedicada

    – Emulação e Depuração – JTAG

    – Controlador de interrupção (até 128 solicitações de interrupção)

    • Memória On-Chip (RAM L3 compartilhada)

    – 64 KB de RAM do controlador de memória on-chip de uso geral (OCMC)

    – Acessível a todos os mestres

    – Suporta retenção para despertar rápido

    • Interfaces de memória externa (EMIF)

    – Controlador mDDR (LPDDR), DDR2, DDR3, DDR3L:

    – mDDR: Clock de 200 MHz (taxa de dados de 400 MHz)

    – DDR2: clock de 266 MHz (taxa de dados de 532 MHz)

    – DDR3: clock de 400 MHz (taxa de dados de 800 MHz)

    – DDR3L: clock de 400 MHz (taxa de dados de 800 MHz)

    – Barramento de dados de 16 bits

    – 1 GB de espaço endereçável total

    – Suporta uma configuração de dispositivo de memória x16 ou duas x8

    – Controlador de memória de uso geral (GPMC)

    – Interface de memória assíncrona flexível de 8 e 16 bits com até sete seleções de chip (NAND, NOR, multiplexado-NOR, SRAM)

    – Usa código BCH para oferecer suporte a ECC de 4, 8 ou 16 bits

    – Usa código de Hamming para oferecer suporte a ECC de 1 bit

    – Módulo Localizador de Erros (ELM)

    – Usado em conjunto com o GPMC para localizar endereços de erros de dados de polinômios de síndrome gerados usando um algoritmo BCH

    – Suporta localização de erros de bloco de 4, 8 e 16 bits por 512 bytes com base em algoritmos BCH

    • Subsistema de Unidade Programável em Tempo Real e Subsistema de Comunicação Industrial (PRU-ICSS)

    – Suporta protocolos como EtherCAT®, PROFIBUS, PROFINET, EtherNet/IP™ e mais

    – Duas Unidades Programáveis ​​em Tempo Real (PRUs)

    – Processador RISC de carga/armazenamento de 32 bits capaz de rodar a 200 MHz

    – 8 KB de RAM de instrução com detecção de erro único (paridade)

    – 8 KB de RAM de dados com detecção de erro único (paridade)

    – Multiplicador de ciclo único de 32 bits com acumulador de 64 bits

    – Módulo GPIO aprimorado fornece suporte para mudança de entrada/saída e trava paralela em sinal externo

    – 12 KB de RAM compartilhada com detecção de erro único (paridade)

    – Três bancos de registros de 120 bytes acessíveis por cada PRU

    – Controlador de interrupção (INTC) para tratamento de eventos de entrada do sistema

    – Barramento de interconexão local para conectar mestres internos e externos aos recursos dentro do PRU-ICSS

    – Periféricos dentro do PRU-ICSS:

    – Uma porta UART com pinos de controle de fluxo, suporta até 12 Mbps

    – Um módulo de captura aprimorada (eCAP)

    – Duas portas Ethernet MII que suportam Ethernet industrial, como EtherCAT

    – Uma porta MDIO

    • Módulo de gerenciamento de energia, reinicialização e relógio (PRCM)

    – Controla a entrada e saída dos modos de espera e sono profundo

    – Responsável pelo sequenciamento do sono, sequenciamento de desligamento do domínio de energia, sequenciamento de despertar e sequenciamento de ativação do domínio de energia

    – Relógios

    – Oscilador de alta frequência integrado de 15 a 35 MHz usado para gerar um relógio de referência para vários relógios de sistema e periféricos

    – Suporta controle individual de ativação e desativação de relógio para subsistemas e periféricos para facilitar a redução do consumo de energia

    – Cinco ADPLLs para gerar relógios de sistema (subsistema MPU, interface DDR, USB e periféricos [MMC e SD, UART, SPI, I 2C], L3, L4, Ethernet, GFX [SGX530], relógio de pixel LCD)

    - Poder

    – Dois domínios de potência não comutáveis ​​(relógio em tempo real [RTC], lógica de despertar [WAKEUP])

    – Três domínios de energia comutáveis ​​(subsistema MPU [MPU], SGX530 [GFX], periféricos e infraestrutura [PER])

    – Implementa SmartReflex™ Classe 2B para dimensionamento de tensão de núcleo com base na temperatura da matriz, variação do processo e desempenho (Adaptive Voltage Scaling [AVS])

    – Escala de frequência de tensão dinâmica (DVFS)

    • Relógio de tempo real (RTC)

    – Informações de data (dia-mês-ano-dia da semana) e hora (horas-minutos-segundos) em tempo real

    – Oscilador interno de 32,768 kHz, lógica RTC e LDO interno de 1,1 V

    – Entrada independente de reinicialização de energia (RTC_PWRONRSTn)

    – Pino de entrada dedicado (EXT_WAKEUP) para eventos de ativação externa

    – O alarme programável pode ser usado para gerar interrupções internas no PRCM (para despertar) ou no Cortex-A8 (para notificação de eventos)

    – O alarme programável pode ser usado com saída externa (PMIC_POWER_EN) para habilitar o CI de gerenciamento de energia para restaurar domínios de energia não RTC

    • Periféricos

    – Até duas portas USB 2.0 DRD (dispositivo de dupla função) de alta velocidade com PHY integrado

    – Até dois MACs Gigabit Ethernet industriais (10, 100, 1000 Mbps)

    – Interruptor Integrado

    – Cada MAC suporta interfaces MII, RMII, RGMII e MDIO

    – MACs e switches Ethernet podem operar independentemente de outras funções

    – Protocolo de Tempo de Precisão IEEE 1588v1 (PTP)

    – Até duas portas de rede de área de controlador (CAN)

    – Suporta CAN Versão 2 Partes A e B

    – Até duas portas seriais de áudio multicanal (McASPs)

    – Transmissão e recepção de relógios de até 50 MHz

    – Até quatro pinos de dados seriais por porta McASP com relógios TX e RX independentes

    – Suporta multiplexação por divisão de tempo (TDM), som Inter-IC (I2S) e formatos semelhantes

    – Suporta transmissão de interface de áudio digital (formatos SPDIF, IEC60958-1 e AES-3)

    – Buffers FIFO para transmissão e recepção (256 bytes)

    – Até seis UARTs

    – Todos os UARTs suportam os modos IrDA e CIR

    – Todos os UARTs suportam controle de fluxo RTS e CTS

    – UART1 suporta controle total do modem

    – Até duas interfaces seriais McSPI mestre e escravo

    – Até duas seleções de fichas

    – Até 48 MHz

    – Até três portas MMC, SD, SDIO

    – Modos MMC, SD, SDIO de 1, 4 e 8 bits

    – O MMCSD0 possui trilho de alimentação dedicado para operação de 1,8 V ou 3,3 V

    – Taxa de transferência de dados de até 48 MHz

    – Suporta detecção de cartão e proteção contra gravação

    – Em conformidade com as especificações MMC4.3, SD, SDIO 2.0

    – Até três interfaces mestre e escravo I 2C

    – Modo Padrão (até 100 kHz)

    – Modo rápido (até 400 kHz)

    – Até quatro bancos de pinos de E/S de uso geral (GPIO)

    – 32 pinos GPIO por banco (multiplexados com outros pinos funcionais)

    – Os pinos GPIO podem ser usados ​​como entradas de interrupção (até duas entradas de interrupção por banco)

    – Até três entradas de eventos DMA externas que também podem ser usadas como entradas de interrupção

    – Oito temporizadores de uso geral de 32 bits

    – DMTIMER1 é um temporizador de 1 ms usado para tiques do sistema operacional (SO)

    – DMTIMER4–DMTIMER7 estão fixados

    – Um temporizador de cão de guarda

    – Motor gráfico 3D SGX530

    – Arquitetura baseada em blocos que fornece até 20 milhões de polígonos por segundo

    – O Universal Scalable Shader Engine (USSE) é um mecanismo multithread que incorpora funcionalidade de pixel e vertex shader

    – Conjunto de recursos avançados de shader além do Microsoft VS3.0, PS3.0 e OGL2.0

    – Suporte de API padrão da indústria para Direct3D Mobile, OGL-ES 1.1 e 2.0 e OpenMax

    – Troca de tarefas refinada, balanceamento de carga e gerenciamento de energia

    – Operação avançada baseada em DMA para interação mínima da CPU

    – Anti-aliasing de imagem programável de alta qualidade

    – Endereçamento de memória totalmente virtualizado para operação do sistema operacional em uma arquitetura de memória unificada

    • Periféricos para jogos

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